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搜索资源列表

  1. pwm1

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  2. xilinx设计并完成一个10位的D/F转换器,输入的数字量分别由按键K1,K2来调节,其中K1完成加1功能,而K2则完成减1功能,并把转换的结构西哦女冠到BUZZ蜂鸣器上。
  3. 所属分类:VHDL编程

    • 发布日期:2014-01-17
    • 文件大小:79450
    • 提供者:haolj
  1. vhdl3

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  2. 时序电路——抢答器,K1、K2、K3、K4各控制一个按钮,DJ代表主持人,在抢答开始前,DJ先按一下按钮,然后在开始比赛,K1—K4中任意按下按钮后,其他钮按下均无效,重新比赛时,DJ需要再按一下按钮。抢答结果用LED显示。
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:97641
    • 提供者:wang
  1. 4x4KEY

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  2. 首先将下载板插到主板上面. 1。源文件保存在src目录,QII的工程文件保存在Proj目录; 2。程序实现的功能测试4×4键盘按键;具体的键值通过板上的数码管来显示。按下K1就显示1,K2就显示2.用户可以试试. 3。具体设计参考代码。
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:70167
    • 提供者:Jak
  1. VGA_COLOR_LINES

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  2. 利用Verilog语言写的VGA彩条显示控制电路,显示器模式:1280X1024@60HZ.按下K1,K2键可控制彩条显示的模式-Use Verilog language is written VGA display control circuit, striped display mode: 1280 X1024 @ 60 HZ. Press the K1, K2 key can control the color display mode. Article
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:620387
    • 提供者:蒲公英
  1. jiaotd

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  2. 用vhdl编的交通灯程序。。1.正常情况下交叉路口的轮流通行(主道3个LED红、黄、绿控制直行,支道3个LED红、黄、绿);并要求主干道每次至少放行30秒;支干道每次至多放行20秒; 2.每次绿灯变红灯,要求黄灯先亮5秒钟。 3.特殊情况控制通行方式控制,用按键开关K1控制主道通行,支道禁行,K2控制支道通行,主道禁行,特殊情况控制通行放行。 4.有紧急情况时用按键开关K0控制两道均为红灯; 5.4位LED数码管能够显示双直行方向绿灯和红灯的等待时间;-Vhdl series o
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:387990
    • 提供者:jackychen
  1. k2

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  2. t6his the last version of the ck!-t6his is the last version of the ck!
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-03
    • 文件大小:10844
    • 提供者:armin4224
  1. add_led

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  2. 利用K1,K2来代替A2 A1 的数据输入。 利用K3,K4来代替B2 B1 的数据输入。 我把A0和B0都设置成1了。 所以一开始数码管显示的是E.应为111加111就等于E 数码管显示相加结果-K1, K2 to replace A2 A1 data input. K3, K4 to replace B2 B1 data input. A0 and B0 are set to 1. So beginning digital display E. should be 111 p
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-16
    • 文件大小:326279
    • 提供者:卢宇生
  1. add

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  2. --a0 a1 a2的输入我们用 k1 k2 k3 代替 --b0 b1 b2的输入我们用拨码开关代替。 --b0用拨码开关1输入,BMK1用杜邦线接24脚 --b1用拨码开关2输入,BMK2用杜邦线接25脚 --b2用拨码开关3输入,BMK3用杜邦线接26脚 --所以一开始数码管显示的是E.应为111加111就等于E(14) --数码管显示相加结果-- A0 a1 a2 input we use k1 k2 k3 instead the- b0 b1 b2 input,
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-27
    • 文件大小:956
    • 提供者:lixiaolong
  1. sub

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  2. --a0 a1 a2的输入我们用 k1 k2 k3 代替 --b0 b1 b2的输入我们用拨码开关代替。 --b0用拨码开关1输入,BMK1用杜邦线接24脚 --b1用拨码开关2输入,BMK2用杜邦线接25脚 --b2用拨码开关3输入,BMK3用杜邦线接26脚 --一开始数码管显示的是0.应为111-111就等于0 --数码管显示相减结果-- A0 a1 a2 input we use k1 k2 k3 instead the- b0 b1 b2 input, we us
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-24
    • 文件大小:903
    • 提供者:lixiaolong
  1. mlt

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  2. --a0 a1 的输入我们用 k1 k2 代替 --b0 b1 的输入我们用 k3 k4 代替 --一开始数码管显示的是9.应为(11)*(11)就等于9 --数码管显示相减结?-- A0 a1 input we use the k1 k2 instead- b0 b1 input with k3 k4 instead- a digital display is 9. (11)* (11) is equivalent to 9- digital display subtract
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-05
    • 文件大小:866
    • 提供者:lixiaolong
  1. xinhaofashengqi

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  2. 多功能信号发生器使用说明书 1.按键部分的使用   K1表示递增锯齿波、K2表示递减锯齿波、K3表示三角波、K4表示阶梯波、K5表示方波、K6表示正弦波、A表示整数部分幅度调节(步进值1V)、A.表示小数部分幅度调节(步进值0.1V)。最后两个按键留作以后升级使用。    2.拨码开关的使用 本次设计使用的是8位的拨码开关,第8位(FC)代表调频,拨通即可调频,第7位(ZANKONG)代表调整方波的占空比,拨通即可调占空比。开关拨通即相应的CPLD输入口为高电平。-Versa
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-12
    • 文件大小:3021162
    • 提供者:程浩武
  1. 1

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  2. 设计一个用于篮球比赛的定时器。要求: (1)定时时间为24秒,按递减方式计时,每隔1秒,定时器减1; (2)定时器的时间用两位数码管显示; (3)设置两个外部控制开关,开关K1控制定时器的直接复位/启动计时,开关K2控制定时器的暂停/连续计时;当定时器递减计时到零(即定时时间到)时,定时器保持零不变,同时发出报警信号,报警信号用一个发光二极管指示。 (4)输入时钟脉冲的频率为50MHz.(Design a timer for a basketball match. Requirement
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-08
    • 文件大小:23552
    • 提供者:LIMBO2K
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