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  1. res

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  2. verilog下fpga4路抢答器,有数码管显示和蜂鸣-verilog next fpga4 Road Responder, a digital display and buzzer
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:5218
    • 提供者:刘欣
  1. checksum_master_onchip2.7z

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  2. 学习sopc builder当中自定制元件的最经典最全面的例子,绝对超值-Learning sopc builder customized component among the most classic examples of the most comprehensive, the absolute value
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:960133
    • 提供者:韩向超
  1. 18-divide-8-divider

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  2. 从ASM状态图可以看出,在state=0时,初始化参数,如果开始信号有效则载入被除数与除数,接着进入state=1状态,首先判断被除数寄存器的高九位是否大于除数,如果是则产生溢出信号,并回到此状态;否则被除数寄存器向左移一位,并进入state=2状态,同样先判断被除数寄存器的高九位是否大于除数,如果是则被数高九位减去除,并被除数最后一位置为1,并回到此状态;否则被除数寄存器向左移一位,并进入state=3状态, 同样先判断被除数寄存器的高六位是否大于除数,如果是则被数高九位减去除,并被除数最后一
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:12171
    • 提供者:Rain
  1. res

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  2. 基于FPGA的六路抢答器的设计,是我毕业设计中的一部分内容,花了很长时间编写的,通过的仿真和实验调试,希望大家喜欢,一起交流,一起进步-FPGA-based design of six-way Responder is my part in the graduation, took a long time writing, through the simulation and experimental testing, hope you like it, with the exchange, t
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2015-04-27
    • 文件大小:1304576
    • 提供者:飞天德
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