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- 这是一些小代码的集合 希望能对大家有所帮助
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- 自动售货机vhdl程序，有波形仿真 quartus2-Vending machine vhdl procedures, simulation waveforms
verilog_testbench_genetator
- 这是一个perl程序 只需要在cmd中运行，参数为你的Verilog名字 功能是:半自动生成Verilog的testbench，提高编码效率-#-----READ ME of verilog_tb_generate.pl----------------------| # | #-----copyright(C) Xzmeng 2010---------------
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- 四层楼电梯控制,每层楼到达停留5个时钟周期。使用状态机。-four floors s elevator design
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- 終極密碼，輸入答案後，開始猜數字，根據所猜數字更改上下限值，解答正確時，出現小星星音樂。+-Ultimate password, enter the answer, start number guessing, based on the number guessing the upper and lower limits of change, to answer correctly, there' s little star.+
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- 基于ARM和FPGA的嵌入式运动控制器的研究-Based on the ARM and FPGA embedded motion controller based on
aaa-crall2
- UCI7701液晶驱动芯片控制程序，能够使其按照指定波形输出数据进行屏幕刷新，自带验证程序-UCI7701 LCD driver chip control procedures, to make it according to the specified waveform output data to refresh the screen, built-in validation process
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- 这是一个基于fpga的，用VHDL语言编写的，关于50M的分频器。-This is an fpga-based, using VHDL language, about 50M divider.
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- 24位加法计数器，每一个信号的上升沿将使得计数器加1，实现从0 -1 -2 -3…… -22 - 23的循环计数器。-24 States adding type counter， every rising-edge signal increases the counter, and making sequence 0-1-2-...-22-23 cycled.