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  1. i2c总线的vhdl实现和vxworks的文件系统.rar

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  2. i2c总线的vhdl实现和vxworks的文件系统,i2c bus VHDL realization and VxWorks file system
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-09
    • 文件大小:16238
    • 提供者:李建平
  1. sd_reader.rar

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  2. SD卡读卡器模块的VHDL及软件驱动代码,可作为外设挂接在Avalon总线上。支持以SD模式、4线模式读取。在24MHz时钟驱动下读取速率可达8MByte/s,SD card reader module and software drivers VHDL code, can be articulated as a peripheral bus in Avalon. To support the SD model, 4-wire mode read. Driven by the 24MHz clo
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-21
    • 文件大小:18282
    • 提供者:ctqy
  1. wishbone_VHDL.rar

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  2. wishbone总线的VHDL源代码 wishbone适用于与FPGA中IP核的高速通信,其接口简单,速度快 成为ip通信的主流,Wishbone Bus VHDL source code Wishbone applicable to IP core in FPGA high-speed communications, and its easy interface, fast becoming the mainstream of ip communications
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-27
    • 文件大小:464769
    • 提供者:王鹏
  1. SDCard_Controller.rar

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  2. SD卡控制器IP. 兼容SD卡协议2.0。与wishbone bus 接口,方便与其他IP连接使用。 ,SD Card Controller IP. Compatible with SD Card Agreement 2.0. With the wishbone bus interface to facilitate the use of other IP connections.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:24642
    • 提供者:xiafei
  1. AMBA-Bus_Verilog_Model

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  2. 该源码包是2.0版本的AMBA总线的Verilog语言模型,主要包括5个部分:AHB总线仲裁器,AHB-APB总线桥接器,AHB总线上从设备ROM模型,AHB总线上从设备RAM模型,参数定义。-This source code package is the model of V2.0 AMBA bus of ARM company, It mainly includes the following five parts: the AHB arbiter,AHB-APB bridge, AHB_R
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2014-04-23
    • 文件大小:17408
    • 提供者:jinjin
  1. CAN_IP.rar

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  2. 这是CAN总线控制器的IP核,源码是由Verilog HDL编写的。其硬件结构与SJA1000类似,满足CAN2.0B协议。,This is a IP core of the CAN bus controller written by the Verilog HDL. whose structure is similar with SJA1000,supporting the protocol of CAN2.0B.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-27
    • 文件大小:61275
    • 提供者:普林斯
  1. CAN_Bus_basis

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  2. 基于CAN总线的汽车仿真。汽车实例为大众途安。分辨率为1024x768。-Based on the CAN bus automotive simulation. Automotive examples for the public Touran. A resolution of 1024x768.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:229646
    • 提供者:张宇
  1. 68K_ebiu

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  2. It contains a vhdl descr iption of the external bus interface unit for 68000 processor. currently only read and write cycle are supported
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:3135
    • 提供者:Pankaj
  1. bus

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  2. 显示总线扩展的_VHDL代码,大家共同学习。-Show that the expansion bus _VHDL code, a common study.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-25
    • 文件大小:192960
    • 提供者:
  1. canbus

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  2. CAN通信协议的硬件描述语言代码,用于FPGA的总线接口控制器开发-CAN communication protocol of the hardware descr iption language code for the FPGA bus interface controller development
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:862211
    • 提供者:shigengxin
  1. clkx_bus

    0下载:
  2. Imprtant example clk bus for VHDL
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-13
    • 文件大小:2708
    • 提供者:Haitham
  1. bus

    0下载:
  2. 一个简单的总线bus代码,初学者可以借鉴学习-A simple bus-bus code, beginners can learn to learn
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:1266
    • 提供者:tom
  1. 486bus

    0下载:
  2. 本代码实现了486总线的功能,初学者可以借鉴学习-This code implements the 486 bus functions, beginners can learn to learn
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-14
    • 文件大小:4050
    • 提供者:tom
  1. LPC2DDR2

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  2. Module Function Descr iption: This module allows a SPI ROM to be used in a LX/CS5536 system. Details are below: 1.Provide a memory window to the SPI EPROM at FFF80000h-FFFFFFFFh (512KB). 2.Provide an interface to the SPI bus to allow the
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:8697
    • 提供者:吴羽中
  1. can_latest.tar

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  2. VHDL/VERILOG FOR CAN BUS Core
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-03
    • 文件大小:1176730
    • 提供者:mss
  1. LIP1732CORE_system_mbus_arbiter

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  2. System Verilog M bus arbiter module
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-27
    • 文件大小:26385
    • 提供者:jc
  1. LIP1731CORE_system_gbus_arbiter

    0下载:
  2. Verilog system G bus arbiter module
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:40611
    • 提供者:jc
  1. LIP1733CORE_system_vbus_arbiter

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  2. Verilog V Bus arbiter module
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:28039
    • 提供者:jc
  1. can_latest[1].tar

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  2. CAN,全称“Controller Area Network”,即控制器局域网,是国际上应用最广泛的现场总线之一。最初,CAN被设计作为汽车环境中的微控制器通讯,在车载各电子控制装置ECU之间交换信息,形成汽车电子控制网络。比如:发动机管理系统、变速箱控制器、仪表装备、电子主干系统中,均嵌入CAN控制装置。 -CAN, full name of the " Controller Area Network" , the Controller Area Network, is int
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:1149787
    • 提供者:zhaohaiting
  1. bus

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  2. 公交车系统基于FPGA芯片的基础上,增加了数码管显示模块、语音自动报站模块、红外通信模块。站牌系统采用以FPGA为核心的主控芯片,增加液晶显示模块、红外通信模块、RS232总线模块、指示灯显示模块等。(The bus system is based on FPGA chip. It adds digital tube display module, voice automatic reporting module and infrared communication module. The bu
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-01
    • 文件大小:6710272
    • 提供者:幽山之隅
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