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搜索资源列表

  1. ALU

    0下载：
  2. David pattern 的ALU模型编码-David pattern in the ALU model code

  3. 所属分类：VHDL-FPGA-Verilog

    • 发布日期：2017-04-07
    • 文件大小：272974
    • 提供者：aguang

  1. adc-by-david

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  2. adc for spartan3e fpga

  3. 所属分类：VHDL-FPGA-Verilog

    • 发布日期：2017-04-13
    • 文件大小：3550
    • 提供者：jason

  1. VerilogHDL_En

    0下载：
  2. this is a working draft containing preliminary mate- rial, some of which the reader is likely to nd obscure.-The Verilog Formal Equivalence (VFE) Project is funded by the U.K. Engineering and Physical Sciences Research Council (EPSRC). The Pri

  3. 所属分类：VHDL-FPGA-Verilog

    • 发布日期：2017-04-16
    • 文件大小：306915
    • 提供者：guxiaozhong

  1. Lab-7(lcd-display)

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  2. lcd display for spartna 3e..will display name sumam david...our hod name-lcd display for spartna 3e..will display name sumam david...our hod name....

  3. 所属分类：VHDL-FPGA-Verilog

    • 发布日期：2017-03-29
    • 文件大小：2427
    • 提供者：vikas
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