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搜索资源列表

  1. Altera DSP BUILDER 9.0 SP2 破解

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  2. Altera DSP BUILDER 9.0 SP2 破解,crack for dsp builder 9.0 SP2

  3. 所属分类：VHDL编程

    • 发布日期：2016-01-25
    • 文件大小：5560
    • 提供者：胡文静

  1. oc_i2c_master_top_v92

    0下载：
  2. I2C IP for Quartus V9.0 sp2, can used in SOPC builder.

  3. 所属分类：VHDL-FPGA-Verilog

    • 发布日期：2017-04-07
    • 文件大小：3525
    • 提供者：homeuser

  1. oc_i2c_master_v92

    0下载：
  2. I2C IP for Quartus V9.0 sp2, can used in SOPC builder.

  3. 所属分类：VHDL-FPGA-Verilog

    • 发布日期：2017-04-06
    • 文件大小：1124
    • 提供者：homeuser

  1. oc_i2c_master_byte_ctrl_v92

    0下载：
  2. I2C IP for Quartus V9.0 sp2, can used in SOPC builder.

  3. 所属分类：VHDL-FPGA-Verilog

    • 发布日期：2017-04-07
    • 文件大小：3086
    • 提供者：homeuser

  1. oc_i2c_master_bit_ctrl_v92

    0下载：
  2. I2C IP for Quartus V9.0 sp2, can used in SOPC builder.

  3. 所属分类：VHDL-FPGA-Verilog

    • 发布日期：2017-04-07
    • 文件大小：3648
    • 提供者：homeuser

  1. ps2

    0下载：
  2. FPGA的SP2端口的实现，将键盘扫描值在数码管上显示-SP2 port FPGA-implementation of the value of the keyboard scan is displayed on the digital

  3. 所属分类：VHDL-FPGA-Verilog

    • 发布日期：2017-04-04
    • 文件大小：645745
    • 提供者：小刘

  1. FPGA_Test_Cap

    0下载：
  2. 波形采集示例源码，在Quartus II 9.1 SP2环境下编译通过。-Waveform acquisition sample source code, compiled by the Quartus II 9.1 SP2 environment.

  3. 所属分类：VHDL-FPGA-Verilog

    • 发布日期：2017-11-15
    • 文件大小：1302908
    • 提供者：Henry
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