搜索资源列表
SOC_EDA
- 利用EDA工具和硬件描述语言（HDL），根据产品的特定要求设计性能价格比高的片上系统，是目前国际上广泛使用的方法。与传统的设计方法不同，在设计开始阶段并不一定需要具体的单片微控制器（MCU）和开发系统(仿真器)以及带有外围电路的线路板来进行调试，所需要的只是由集成电路制造厂家提供的用HDL描述的MCU核和各种外围器件的HDL模块。设计人员在EDA工具提供的虚拟环境下，不但可以编写和调试汇编程序，也可以用HDL设计、仿真和调试具有自己特色的快速算法电路和接口，并通过综合和布线工具自动转换为电路结构
shuzizhongsheji
- 多功能数字钟设计 一、设计任务： （一）主体功能 用HDL设计一个多功能数字钟，包含以下主要功能： 1.计时及校时，时间可以24小时制或12小时制显示 2.日历：显示年月日星期，及设定设定功能 3.跑表：启动/停止/保持显示/清除 4.闹钟：设定闹钟时间，整点提示 -multifunctional design of a digital clock, design tasks : (1) the main function of HDL design with a
Matlab.zip
- 课程设计中首先采用Ising model的思想建立一个二维的模型，然后利用重要性抽样和Monte Carlo方法及其思想模拟铁磁-顺磁相变过程。计算了顺磁物质的能量平均值Ev、热容Cv、磁化强度M及磁化率X的值，进而研究Ev、Cv、M、X与温度T的变化关系并绘制成Ev-T图、Cv-T图、M-T图、X-T图，得出顺磁物质的内能随着温度的升高先增大而后趋于稳定值；热容Cv、磁化率X随着温度的升高先增大后减小；磁化强度M在转变温度Tc处迅速减小为零，找出铁磁相变的转变温度Tc大约为2.35,First
pld MegaWizard Plug-In Manager
- 利用QuartusII的"MegaWizard Plug-In Manager", 设计输入数据宽度是4bit的ADD、SUB、MULT、DIVIDE、COMPARE 把它们作为一个project,DEVICE选用EPF10K70RC240-4，对它们进行 时序仿真，将仿真波形（输入输出选用group）在一页纸上打印出来。 2.利用QuartusII的"MegaWizard Plug-In Manager"中的LPM_
fre_ctrl
- 利用verilog语言，从上至下层次管理的设计思想；Verilog HDL的行为描述和结构描述,实现8位频率计，4个0检测修正电路的原理说明-The use of Verilog language, top-down hierarchical management design idea Verilog HDL descr iption of the behavior and structure of a descr iption of the realization of frequency
ABEL-HDL_Reference
- VHDL进行设计输入开发的工具，好东西，快下载-VHDL design input to develop a tool for good, fast download
Impulse_fft_hw
- ImpulseC Codeveloper fft code. This file implements the hardware portion of a 256 sample FFT using a radix-4 algorithm. This implementation demonstrates that results similar to hand-coded HDL can be achieved using the C language, and without using
verilog
- 讲述的是verilog HDL 的一些实际应用与联系。还宝库奥一些总结性的知识。-About the verilog HDL and contact some of the practical application. Treasure-house of Austria is also a number of conclusive knowledge.
VerilogHDL_tuxiang
- 介绍一种用于卫星姿态测量的CMOS图像敏感器--STAR250的时序驱动信号，并使用Verilog HDL语言设计驱动时序电路。经布线、仿真、测试后验证了驱动信号的正确性。 -Introduce a measurement for the satellite attitude CMOS image sensor- STAR250 timing drive signals, and use the Verilog HDL language design-driven sequential circ
51_IP_CORE
- 用HDL硬件描述语言写成的MCS51系列单片机IP核，其中包括4位的MCU，内容系4篇硕士论文，其中两个需要用CAJ阅读器打开 -HDL Hardware Descr iption Language with written MCS51 Microcontroller IP core, including 4-bit MCU, the contents of a master' s thesis, Department 4, two of which need to open the
verilog
- A popular cookbook describing the Verilog language for the design of integrated circuits. Verilog is the alternative to VHDL and is the favoured HDL design language in the USA. It is easier (quicker) to learn than VHDL because it is not so tightly ty
fjq2
- CPLD 支持在系统可编程( ISP) 技术, ISP 技术是 通信专用集成电路设计的一种最新设计方法, 它使得数 字电路设计、生产和维护发生革命性的变化[1 ]。本文对 数字语音通信系统中的复接ö 分接器进行了详细的设计 分析, 并利用软件MAX+ PLU S II 和V erilog- HDL 语 言进行具体的仿真和设计。-CPLD supports in-system programmable (ISP) technology, ISP Communicatio
I2C
- 一种IIC的vhdl实现，包含相关sourcecode和协议文档，学习verilog hdl的好资料。-A kind of IIC' s vhdl implementation, the agreement contains the relevant sourcecode and documentation, learning verilog hdl good information.
FPGAdeguangshanjiancejishu
- 本文档设计了1光栅位移传感器信号的接收、光栅位移传感器信号的整形及电平转换电路设计，用Verilog HDL描述了锁相倍频细分和零位信号处理电路。利用FPGA实现光栅位移系统与上位机接口的电路原理框图-This document designed a grating displacement sensor signal reception, grating displacement sensor signal shaping and level conversion circuit design
Verilog_HDL
- 在微型计算机系统中，CPU与外部的基本通信方式有两种，一种是并行通信即数据的各位同 时传送，其优点是传输速度较快，但数据有多少位就需要多少条传送线；而串行通信中数据一位一位顺序传 送，能节省传送线．用Vefilog HDL语言实现了串并、并串通信接口之间的转换-In the micro-computer systems, CPU basic communication with the outside there are two types of parallel data commun
IO
- 针对I/O的数字设计解决方案 数字电路设计者采用了一系列方法来提高信号速度和消除I/O问题。例如，采用差分信号处理来 提高芯片间的通信速度。信号同步、源同步和自同步之类的设计方法改善了内部IC（集成电路） 通信，在满足计算机行业所需速度的前提下，提供了可靠的输入/输出。-In the micro-computer systems, CPU basic communication with the outside there are two types of parallel data
Verilog_shuzisheji
- 本章的目的是想通过对数字信号处理、计算（Computing）、算法和数据结构、编程语言和 程序、体系结构和硬线逻辑等基本概念的介绍，了解算法与硬线逻辑之间的关系从而引入 利用Verilog HDL 硬件描述语言设计复杂的数字逻辑系统的概念和方法。向读者展示一种 九十年代才真正开始在美国等先进的工业国家逐步推广的数字逻辑系统的设计方法-Purpose of this chapter is to through digital signal processing, computing (
Verilog-HDL
- verilog HDL程序入门，很好学，基本和C语言一样，几天就可以简单的编程-verilog HDL program entry, very good school, Basic and C language, a few days can be a simple programming
lab-4-cpu-design-with-Verilog-HDL
- 用veriloghdl 编写的cpu代码，modusim仿真通过，包括原理图和代码，以实验报告形式写出-CPU code, written in veriloghdl modusim simulation through, including the principle diagram and code, in the form of a lab report write
hdl-manual
- Its a manual which consists of many vhdl programmes for beginners willing to learn VHDL and Verilog