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  1. 1820

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  2. 单片机测温度 学习51的可以看一下-Study measured the temperature of the microcontroller 51 can look
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2017-04-10
    • 文件大小:1414
    • 提供者:lihui
  1. SwitchDetectionAndAlarm

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  2. 当触动开关时,内部扬声器发出间断的蜂鸣声,并且4个LED指示灯循环闪烁。一段时间后,LED指示灯熄灭,蜂鸣声停止。随后LED显示屏开始从9到0倒计时,若在倒计时的过程中,再次触动开关,就会发出所设计的第二种警报:内部扬声器发出持续蜂鸣声,并且4个LED指示灯共同忽明忽暗闪烁。同样持续一段时间后,LED指示灯熄灭,蜂鸣声停止。-When a switch, the internal speaker intermittent beeps, flashes and four LED lights cy
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2017-04-07
    • 文件大小:1414
    • 提供者:liwei
  1. GetKey

    0下载:
  2. cpld的按键处理,偶数分数,奇数分频,小数分频-cpld key handling, even scores the odd frequency, fractional-N
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2017-04-12
    • 文件大小:1414
    • 提供者:pressbri
  1. dtmf_dec

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  2. 采用matlab编程的DTMF检测程序仿真,经过测试,绝对可用,可检测多个DTMF信号!-using Matlab programming DTMF detection process simulation, tested and absolutely can be used, can detect DTMF signals over!
  3. 所属分类:DSP编程

    • 发布日期:2008-10-13
    • 文件大小:1413
    • 提供者:duzhou
  1. 11.18FINAL

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  2. 使智能车循黑线走简单赛道,具有一定的调速功能,但尚未引入更好的PID控制.
  3. 所属分类:其他嵌入式/单片机内容

    • 发布日期:2008-10-13
    • 文件大小:1413
    • 提供者:家弘
  1. counter

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  2. Counter module that implements the counter module in VHDL.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1413
    • 提供者:Shahid Rizwan
  1. hightfrquencydivider

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  2. 用VerilogHDL语言实现一个被除数为8位,除数为4为的高效除法器,实现高效的除法功能-VerilogHDL language with a dividend of 8 bits, the divisor is 4 for the high divider, a high efficiency of the division function
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:1413
    • 提供者:张茂磊
  1. fir_lms

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  2. verilog语言编写LMS(最小均方误差)自适应滤波器。-verilog language LMS (least mean square error) adaptive filter.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:1413
    • 提供者:刘俊斌
  1. adc

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  2. MAX1167 16位AD读写操作。基于Atmega64. 本文件包括adc.h和adc.c,直接调用即可。-MAX1167 16-bit the AD read and write operations. Based on the Atmega64. Documents including adc.h and adc.c can be called directly.
  3. 所属分类:Other Embeded program

    • 发布日期:2017-11-18
    • 文件大小:1413
    • 提供者:王宇航
  1. clock

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  2. 一个简单的数字时钟Verilog仿真程序,60秒1分钟,60分一小时,24小时一天,265天一年。代码逻辑简化不含状态机,易理解。附激励文件可直接仿真。-A simple digital clock Verilog simulation program 60 seconds, 1 minute, 60 hours, 24 hours a day, 265 days a year. The code logic simplifies excluding state machine, easy to
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-06
    • 文件大小:1413
    • 提供者:Welson
  1. div_clk

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  2. 一个20M转16M的时钟分频设计的小程序。有一定的漏洞请大家自行修正-A 20M to 16M clock frequency applet. There are some loopholes Please correct itself
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-08
    • 文件大小:1413
    • 提供者:yang
  1. TLV5638

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  2. ti公司的DA转换芯片的51单片机驱动程序,能够选择,参考源,两路同输出。想要精确度高,就选外部参考源-51 singlechip Ti, DA conversion chip driver, can choose, reference source, two output. Want to high precision, choose external reference source
  3. 所属分类:SCM

    • 发布日期:2017-04-10
    • 文件大小:1413
    • 提供者:林波
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