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  1. 1alljia

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  2. 只要或上有事件发生,门实例语句即被执行。只要或上有事件发生,就执行语句,并且只要或上有事件发生,就执行连续赋值语句。
  3. 所属分类:其他嵌入式/单片机内容

    • 发布日期:2008-10-13
    • 文件大小:813
    • 提供者:sy
  1. pwm

    2下载:
  2. 89C51单片机用定时器来产生PWM方波,方波的频率与占空比可调
  3. 所属分类:其他嵌入式/单片机内容

    • 发布日期:2008-10-13
    • 文件大小:813
    • 提供者:杨志
  1. main

    0下载:
  2. TI公司的ZigBee模块 cc2530单片机带屏基础实验---LCD-test-TI ZigBee module CC2530 chip with screen based experiment--- LCD-test
  3. 所属分类:Other Embeded program

    • 发布日期:2017-03-28
    • 文件大小:813
    • 提供者:俞建
  1. interruput

    0下载:
  2. 利用定时/计数器T0从P1.0输出周期为1s的方波,让发光二极管以1HZ闪烁,设晶振频率为12MHz。 使用的是T0口在1方式下工作的-Use timing counter T0 from P1.0 output/1s of square wave period, let light emitting diode to 1HZ flashing, set crystal frequency for 12MHz. Use is T0 mouth in 1 mode
  3. 所属分类:Other Embeded program

    • 发布日期:2017-03-24
    • 文件大小:813
    • 提供者:anyong
  1. New-folder

    0下载:
  2. VHDL for Johnson counter
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:813
    • 提供者:Ashwin
  1. 001-P1.0LED

    0下载:
  2. 单片机流水灯程序,是新手的好帮手,希望能对你有帮助!- Flowing water light microcontroller program, is new good helper, the hope can help you
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:813
    • 提供者:王东庭
  1. tb_sigma_h

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  2. test bench for sigma delta
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:813
    • 提供者:Renu Mary
  1. testeLCD

    0下载:
  2. código para dysplay LCD 4Bits no ATMEGA328
  3. 所属分类:Other Embeded program

    • 发布日期:2017-04-11
    • 文件大小:813
    • 提供者:iaan
  1. LMS_algorithm_matlab

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  2. 此matlab代码介绍了LMS(leastMeansquare)的算法实现,具有很好的参考价值-LMS algorithm in adaptive algorithm using a very wide range. Reversal of the traditional the offset algorithm that using this algorithm. This matlab code program great reference significance of the adap
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-15
    • 文件大小:813
    • 提供者:brianwu
  1. minute_ct

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  2. 采用VHDL语言设计的分钟计时器,是时钟设计的一部分,已仿真和测试通过。-Design using VHDL-minute timer, the clock part of the design, simulation and testing has been passed.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:813
    • 提供者:xzb
  1. MtoNgencount

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  2. Consider a counter that counts from m to n and then wraps around. Derive HDL code for the counter. Use generics, M and N, for m and n of the counter.(Note: there should be one control as UP/DOWN such that when UP/DOWN=1 then counts UP and for 0 it co
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:813
    • 提供者:Aftab Rai
  1. ex1

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  2. PC104总线,使接在PB口上的4个绿灯亮,4个红灯灭-PC104 bus, so connected to the PB port 4 green light, red light off 4
  3. 所属分类:Other Embeded program

    • 发布日期:2017-03-28
    • 文件大小:813
    • 提供者:陈珠英
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