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100vhdl例子
- 100vhdl例子 应用于各基础电路或高级电路的基础部分-100vhdl example of the basic circuit used senior circuit or part of the foundation
program_all
- 此文件里为我多年收集的子程序模块源代码，对于初学者很适用。用多种语句描叙，有常用的基本电路模块描叙。-this document for many years I collected subroutine module source code, the application for beginners. Using a variety of statements depicts a common basic circuit module depicts.
data_transfer
- 同步串行数据发送电路SSDT的基本功能是将并行数据转换成串行数据并进行同步发送。系统写入和读出时序完全兼容Intel8086时序。 系统以同步信号开始连续发送四个字节，在发送中出现5个1时插入一个0，在四个数据发送结束而下一次同步没有开始之前，发送7FH，这时中间不需要插入零 -synchronous serial data transmission circuit SSDT the basic function is to convert parallel data into seri
TOKEN_vrilog
- 同步串行数据发送电路SSDT的基本功能是将并行数据转换成串行数据并进行同步发送。系统写入和读出时序完全兼容Intel8086时序。 系统以同步信号开始连续发送四个字节，在发送中出现5个1时插入一个0，在四个数据发送结束而下一次同步没有开始之前，发送7FH，这时中间不需要插入零 -synchronous serial data transmission circuit SSDT the basic function is to convert parallel data into seri
vhdl
- vhdl基本门电路，都是些比较经典的设计实例-VHDL basic gate circuit, are relatively more examples of classic design
vhdl
- 讲述了VHDL语言的基本应用，软件的基本功能和使用方法，以及数字电路设计的相关资料-VHDL language about the basic application, the software s basic functions and the use of methods, and digital circuit design of relevant information
bhgfdti
- 含有七人表决器，格雷码变换电路，英文字符显示电路，基本触发器（D和JK），74LS160计数器功能模块，步长可变的加减计数器-Containing seven people vote, and Gray code conversion circuit, the English characters display circuit, the basic flip-flop (D and JK), 74LS160 counter function modules, variable-step add
VHDL
- VHDL设计实体的基本结构 VHDL的语言要素 用VHDL实现电路设计的方法 VHDL设计流程-VHDL design entities, the basic structure of the language element of VHDL using VHDL circuit design approach to achieve VHDL design flow
CPLD_FPGA
- 基于CPLD/FPGA的数字通信系统建模与设计，里面讲述了通信系统的VHDL建模和各种基本电路的建模与设计，在通信原理课程设计中一般会用到！-Based on CPLD/FPGA Digital Communication System Modeling and Design, which describes VHDL modeling of communication systems and a variety of basic circuit modeling and design, pri
mux2to1
- 二选一电路，实现最基本的电路信号输出选择，抢答器等判断电路的基础电路-Alternative circuits, realize the basic circuit signal output devices such as choice, vies to answer first based circuit judge circuit
sqrt-base-on-fpga
- 对一种改进的不恢复余数的开方算法(non - restoring square - root algorithm)进行了讨论 ,并将其应用于基于 IEEE 754 标准的32 位浮点格式的开方运算中 ,以一款 FPGA 为载体 ,实现了进行运算的基本电路。对目前存在的几种开方 算法进行了评述 ,分析了他们的优缺点 ,提出了改进的不恢复余数开方算法模块化的设计思路与关键电路 ,并分析了仿真和 逻辑综合的结果 ,证明了该算法运算速度较快且占用资源极少的特点。-An improved no
Circuit-Design-with-VHDL
- VHDL数字电路设计教程 作者：（巴西）佩德罗尼（Pedroni,V.A.） 著，乔庐峰 等译 本书采用将数字电路系统设计实例与可编程逻辑相结合的方法，通过大量实例，对如何采用VHDL进行电路设计进行了全面阐述。 本书分为三大部分：首先详细介绍VHDL语言的背景知识、基本语法结构和VHDL代码的编写方法；然后介绍VHDL电路单元库的结构和使用方法，以及如何将新的设计加入到现有的或自己新建立的单元库中，以便于进行代码的分割、共享和重用；最后介绍PLD和FPGA的发展历史、主流厂
mux4Pchoose8
- 四选一选择器和83编码器，适合新手，基本电路-Four and 83 choose a selector encoder, suitable for novice, basic circuit
Verilog
- verilog基本电路设计指导书 作为初学者很有用-Verilog basic circuit design procedure
VHDL-Circuit-design
- 本教程旨在VHDL语言编写程序提供基础性知识，辅助完成简单硬件程序设计 主要内容为：VHDL基本描述语句-This tutorial is designed VHDL language program to provide basic knowledge, secondary to complete a simple hardware programming The main contents are: the VHDL basic descr iption of the stateme
frame-synchronous-search-circuit
- 用verilog语言编写的帧同步搜索电路，输入数据data为8 bit并行数据流，基本结构为数据帧，帧长为10字节，帧同步字为H“FF”。clk为输入同步时钟。-Verilog language for frame synchronous search circuit, the input data is data for the 8-bit parallel data stream, the basic structure of the data frame, the frame lengt
EP1C3T144_develop
- EP1C3T144最小系统板原理图，包括完整的电源电路、下载配置电路、基本测试电路。-EP1C3T144 minimum system board schematic diagram, including the power supply circuit, complete download configuration circuit, basic circuit.
Verilog_guide(HUAWEI)
- Verilog基本电路设计指导书(华为资料),华为内部Verilog教学资料-Verilog basic circuit design guide book (Huawei data), Huawei internal Verilog teaching materials
VerilogBasicICDesign
- Verilog基本电路设计,包括时钟域同步、无缝切换、 异步FIFO、去抖滤波-Verilog basic circuit design, including clock domain synchronization, seamless switching, asynchronous FIFO, debounce filter
design guideline for verilog basic circuit
- basic circuit design based on verilog