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  1. install-vxworks62-ppc

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  2. install txt for vxworks 6.2 powerpc license文件-install txt for vxworks 6.2 powerpc
  3. 所属分类:VxWorks

    • 发布日期:2017-03-28
    • 文件大小:596
    • 提供者:seth
  1. 38

    0下载:
  2. 采用CASE语句设计3-8译码器的示例程序-Designed using CASE statement 3-8 decoder examples of procedures
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:596
    • 提供者:赵朴
  1. working

    0下载:
  2. 用计数器定期启动一个函数MyFun-use a timer to start a function
  3. 所属分类:DSP program

    • 发布日期:2017-04-06
    • 文件大小:596
    • 提供者:李楠
  1. in430

    0下载:
  2. OS : ucos-2 Target : MSP430
  3. 所属分类:uCOS

    • 发布日期:2017-04-10
    • 文件大小:596
    • 提供者:shin young ho
  1. zshylbw

    0下载:
  2. 利用adapt函数对自适应滤波网络对时变正弦信号进行自适应预测。-Adapt the use of adaptive filtering function network for time-varying sinusoidal signal adaptive prediction.
  3. 所属分类:DSP program

    • 发布日期:2017-04-10
    • 文件大小:596
    • 提供者:qiulan
  1. wave_gen_timing

    0下载:
  2. Clock generation in VHDL
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:596
    • 提供者:Haitham
  1. list_ch12_08_dot_top

    0下载:
  2. VGA synchronization Code (640 x 480). It generetes VGA synchornization with only 3 bit color ang 60 hz refresh rate. The source clock is 50 MHz.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:596
    • 提供者:Geoff
  1. bingchuan

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  2. 由于我是一个初学者,代码程序不是很好,希望学长多关照小弟。-Since I was a beginner, code program is not very good, I hope the seniors more than take care of the little brother.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-03
    • 文件大小:596
    • 提供者:桂斌
  1. adsawfd

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  2. 用Verilog HDL设计3线-8线译码器,ena是译码器的使能控制端,当ena=1时译码器工作,ena=0时译码器被禁止,8个输出均为高电平 用Verilog HDL设计具有三态输出的8D锁存器。-3-to-8 line decoder, ENA is designed using Verilog HDL the decoder enable control terminal, when ena = 1 time decoder, ENA = 0 time decoder is disa
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-20
    • 文件大小:596
    • 提供者:赵玉著
  1. Unsigned-byte-operations

    0下载:
  2. 无符号双字节运算,只是子程序,可直接复制到程序里,然后调用。无符号双字节运算。-Unsigned byte operation, only the subroutine, can be directly copied into the program, and then call. Unsigned byte operations。
  3. 所属分类:SCM

    • 发布日期:2017-04-10
    • 文件大小:596
    • 提供者:梁海标
  1. CNT10

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  2. vhdl设计的十进制计数器,仿真测试正确,可以使用。-decimal counter vhdl design, simulation tests correctly, can be used.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:596
    • 提供者:高立新
  1. chuankou

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  2. 单片机串口通信,使用单片机C语言,基于郭天祥的铁牛单片机开发-Serial Communication using microcontroller C language
  3. 所属分类:SCM

    • 发布日期:2017-04-12
    • 文件大小:596
    • 提供者: 王小姐
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