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  1. WhiteBalance_10bit

    1下载:
  2. 模块功能:通过白平衡消除由光照带来色差(绿雾) 模块输入:亮度增益输出R,G,B三通道像素值(double) 模块输出:白平衡后R,G,B三通道像素值(double)(Module function: to eliminate chromatic aberration (green fog) caused by illumination through white balance. Module input: brightness gain output R, G, B three c
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2020-10-13
    • 文件大小:1024
    • 提供者:Andy1123
  1. uart_rx

    1下载:
  2. Verilog实现的RS232发送和接收程序,有完成的verilog代码,testbench等。(UART send and receive verilog code, including verilog source code, testbench etc.)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2019-07-27
    • 文件大小:452608
    • 提供者:66778899
  1. 基于GMR-1系统下行链路的π_4-CQPSK解调方法

    1下载:
  2. pi4 qpsk的付费论文,讲述FPGA实现的,非常值得学习(Pi4 QPSK's paid papers will be very useful for FPGA.)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2020-12-15
    • 文件大小:516096
    • 提供者:Haiton
  1. VerilogHDL解码DS18B20

    1下载:
  2. DS18B20解码代码,verilogHDL实现。
  3. 所属分类:VHDL编程

  1. Eagle_DataSheet_v1.9 - EG4X20BG256.pdf

    1下载:
  2. Eagle DataSheet v1.9 - EG4X20BG256
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2019-08-16
    • 文件大小:3649536
    • 提供者:rotzeimer
  1. TR4_GPIO1_D8M

    1下载:
  2. 友晶科技的TR4的开发板,接上D8M摄像头的程序 输出的是MIPI解码后的10位数据 内带signaltap仿真结果和连接图(The development board of TR4, the D8M camera program. The output is the 10 bit data after MIPI decoding. include signaltap simulation results and connection diagrams)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2020-03-03
    • 文件大小:28826624
    • 提供者:xttttttT
  1. teacher_uart

    1下载:
  2. 由verilog编写的uart收发模块,能够在串口助手发送字符,并在数码管上显示,开发板为basys3 内置约束文件(The UART transceiver module written by Verilog can send characters to serial assistant and display them on the digital tube. the development board is built-in constraint file of basys3)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2019-03-26
    • 文件大小:1925120
    • 提供者:abc1997
  1. DDR_sdram

    1下载:
  2. 文件里有DDR3/DDR4 sram的verliog模型,而且具有DDR4参考书(The document has a verliog model of DDR3/DDR4 SRAM, and it has DDR4 reference books.)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2019-03-06
    • 文件大小:4935680
    • 提供者:maxw123456789
  1. FIFO_UVM

    1下载:
  2. fifo uvm this is total fifo tb with uvm including score board with total uvm_topology with test cases with rtl giving proper output(this is total fifo tb with uvm including score board with total uvm_topology with test cases with rtl giving prop
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2019-05-27
    • 文件大小:231424
    • 提供者:gana123
  1. A4_Da_Top

    1下载:
  2. 利用AD、DA和VGA三个外设来实现简易示波器,DA外设发送正弦波给AD外设,AD外设解析成数字信号将数据送给VGA外设进行显示。在VGA上可以看到DA外设发送的波形、波形频率和波形峰峰值。(The simple oscilloscope is realized by using AD, DA and VGA peripherals. The DA peripheral sends sine wave to the AD peripheral, and the AD peripheral res
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2020-03-01
    • 文件大小:3430400
    • 提供者:电子鱼
  1. FPGA

    1下载:
  2. ⑴实验要求基本要求: ①设置一个复位键,按下按键输出电压清零 ②设置两个功能键,控制输出电压以0.2V的步长进行加减。(Pin sets a reset button, press the button to output the voltage reset You set two function keys to control the output voltage by 0.2v step size.)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2019-10-18
    • 文件大小:1024
    • 提供者:孟欢520
  1. shift&scrambler

    1下载:
  2. shift &scramble codes and it tb
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2019-04-27
    • 文件大小:5120
    • 提供者:longtian0524
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